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基于 Integrity 3D-IC 平台的新设计流程,以支持 TSMC 3Dblox™ 标准

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内容提要

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Cadence Integrity 3D-IC 平台是一个完整的解决方案,已通过所有最新 TSMC 3DFabric 产品的认证,结合了系统规划、封装和系统级分析功能,提供无缝的设计创建和签核流程

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流程经过精细调整,支持 3Dblox,能加速复杂系统的 3D 前端设计分区

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Cadence 和 TSMC 的技术有助于提高 3D-IC 的设计质量,加快周转时间。3D-IC 常被应用于 5G、AI、超大规模计算、物联网和手机领域

中国上海,2023 年 5 月 8 日——楷登电子(美国 Cadence 公司,NASDAQ:CDNS)近日宣布推出基于 Cadence® Integrity 3D-IC 平台的新设计流程,以支持 TSMC 3Dblox 标准。TSMC 3Dblox 标准适用于在复杂系统中实现 3D 前端设计分区。通过此次最新合作,Cadence 流程优化了所有 TSMC 最新 3DFabric 供需目录上的产品,包括集成扇出(InFO)、基板上晶圆上芯片(CoWoS®)和系统整合芯片(TSMC-SoIC®)技术。利用这些设计流程,客户能够加速先进的多芯片封装设计开发,以应对面向新兴的 5G、AI、手机、超大规模计算和物联网应用。

Cadence Integrity 3D-IC 平台结合了系统规划、封装和系统级分析功能,是一个完整的解决方案,且经过了 TSMC 3DFabric 和 3Dblox 1.5 规格认证。基于该平台的流程包含了一些新的功能,如 3D 布通率驱动的 bump 分配和分级 bump 资源规划。

Integrity 3D-IC 平台本身就支持 3Dblox,3Dblox 为 Cadence 系统分析工具提供了一个无缝接口,通过 Cadence Voltus IC Power Integrity Solution 和 Celsius Thermal Solver 系统分析工具进行早期电源供电网络(PDN)和热分析,通过 Cadence Quantus Extraction Solution 和 Tempus Timing Signoff Solution 提供提取和静态时序分析,并通过 Cadence Pegasus Verification System 提供系统级电路布局验证(LVS)检查。

“3D-IC 技术是满足下一代 HPC 和手机应用在性能、物理尺寸和功耗要求上的关键,”TSMC 设计基础设施管理部门负责人 Dan Kochpatcharin 表示,“通过继续与 Cadence 合作,我们的客户能利用全面的 3DFabric 技术和支持 3Dblox 标准的 Cadence 流程,可以显著提高 3D-IC 设计的生产力并加快产品上市。”

“基于 Integrity 3D-IC 平台的 Cadence 流程集 合了客户进行 3D-IC 设置所需的一切,让其可以快速使用 TSMC 最新的 3DFabric 技术设计领先的 3D-IC,”Cadence 公司资深副总裁兼数字和签核事业部总经理 Chin-Chi Teng 博士说,“通过与 TSMC 的广泛合作,我们正在共同解决客户经常面临的 3D-IC 设计挑战,帮助他们进入把创新设计引入生活的加速通道。”


   

Cadence Integrity 3D-IC 平台,包括 Allegro X 封装技术,是公司更广泛的 3D-IC 产品系列中的一员,与Cadence 智能系统设计(Intelligent System Design)战略保持一致,助力实现卓越的系统级芯片(SoC)设计。


来源:Cadence楷登
ACTSystemHPC电源电路航空汽车电子消费电子芯片UMCadence
著作权归作者所有,欢迎分享,未经许可,不得转载
首次发布时间:2025-10-04
最近编辑:9小时前
Cadence楷登
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CFD 建模与仿真

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